${\eta}_T$ Pairing 알고리즘의 효율적인 하드웨어 구현

Vol. 20, No. 1, pp. 3-16, 2월. 2010
10.13089/JKIISC.2010.20.1.3, Full Text:
Keywords: ${\eta}_T$ pairing, Eta-T pairing, finite field arithmetic, hardware coprocessor, FPGA, Elliptic curve
Abstract

최근 무선 센서 네트워크 보안 분야에서는 키 교환을 위한 부가적인 통신이 필요 없이 통신 엔터티 상호간에 암호화를 수행할 수 있는 페어링 암호가 주목받고 있다. 본 논문에서는 이러한 페어링 암호의 한 종류인 ${\eta}_T$ 페어링에 대한 효율적인 하드웨어 구현을 제시한다. 이를 위해 병렬 처리 및 레지스터/자원의 최적화에 기반한 ${\eta}_T$ 페어링 알고리즘에 대한 효율적인 하드웨어 구조를 제안하며, 제안한 구조를 GF($2^{239}$) 상에서 FPGA로 구현한 결과를 나타낸다. 제안한 구조는 기존의 구현 결과에 비해 Area Time Product에 있어 15% 나은 결과를 가진다.

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Cite this article
[IEEE Style]
D. Lee, C. Lee, D. Choi, C. Kim, E. Choi and H. Kim, "Efficient Hardware Implementation of ${\eta}_T$ Pairing Based Cryptography," Journal of The Korea Institute of Information Security and Cryptology, vol. 20, no. 1, pp. 3-16, 2010. DOI: 10.13089/JKIISC.2010.20.1.3.

[ACM Style]
Dong-Geoon Lee, Chul-Hee Lee, Doo-Ho Choi, Chul-Su Kim, Eun-Young Choi, and Ho-Won Kim. 2010. Efficient Hardware Implementation of ${\eta}_T$ Pairing Based Cryptography. Journal of The Korea Institute of Information Security and Cryptology, 20, 1, (2010), 3-16. DOI: 10.13089/JKIISC.2010.20.1.3.